DDR總線一致性測(cè)試

工業(yè)標(biāo)準(zhǔn)總線一致性測(cè)量概述

高速數(shù)字系統(tǒng)使用了各種工業(yè)標(biāo)準(zhǔn)總線，對(duì)這些工業(yè)標(biāo)準(zhǔn)總線進(jìn)行規(guī)范一致性測(cè)量是確 保系統(tǒng)工作穩(wěn)定和可靠的關(guān)鍵點(diǎn)之一。“一致性”是對(duì)英文單詞“Compliance”的中文解釋， 美國(guó)把按工業(yè)標(biāo)準(zhǔn)規(guī)范進(jìn)行的電氣參數(shù)測(cè)量叫作一致性測(cè)量。

測(cè)試這些工業(yè)標(biāo)準(zhǔn)總線，完整和可靠的測(cè)試方案是非常重要的。完整的測(cè)試方案不僅保證測(cè)試準(zhǔn)確度，還可以大量節(jié)省測(cè)試時(shí)間，提高工作效率。

工業(yè)標(biāo)準(zhǔn)總線完整的測(cè)試方案一般包括幾部分：測(cè)試夾具；探頭和附件；自動(dòng)測(cè)試軟件;測(cè)試儀器。 快速 DDR4協(xié)議解碼功能.浙江DDR一致性測(cè)試銷(xiāo)售電話

軟件運(yùn)行后，示波器會(huì)自動(dòng)設(shè)置時(shí)基、垂直增益、觸發(fā)等參數(shù)并進(jìn)行測(cè)量，測(cè)量結(jié)果會(huì) 匯總成一個(gè)html格式的測(cè)試報(bào)告，報(bào)告中列出了測(cè)試的項(xiàng)目、是否通過(guò)、spec的要求、實(shí)測(cè) 值、margin等。

使用自動(dòng)測(cè)試軟件的優(yōu)點(diǎn)如下所述：

?自動(dòng)化的設(shè)置向?qū)П苊膺B接和設(shè)置錯(cuò)誤；

?快速的測(cè)量和優(yōu)化的算法減少測(cè)試時(shí)間；

?可以測(cè)試JEDEC規(guī)定的速率也可以測(cè)試用戶自定義的數(shù)據(jù)速率;

?獨(dú)有的自動(dòng)讀寫(xiě)分離技術(shù)簡(jiǎn)化了測(cè)試操作；

?能夠多次測(cè)量并給出一個(gè)統(tǒng)計(jì)的結(jié)果；

?能夠根據(jù)信號(hào)斜率自動(dòng)計(jì)算建立/保持時(shí)間的修正值。 自動(dòng)化DDR一致性測(cè)試多端口矩陣測(cè)試用于 DDR、DDR2、DDR3、DDR4 調(diào)試和驗(yàn)證的總線解碼器。

以上只是 一 些進(jìn)行DDR讀/寫(xiě)信號(hào)分離的常用方法，根據(jù)不同的信號(hào)情況可以做選 擇。對(duì)于DDR信號(hào)的 一 致性測(cè)試來(lái)說(shuō)，用戶還可以選擇另外的方法，比如根據(jù)建立/保持 時(shí)間的不同進(jìn)行分離或者基于CA信號(hào)突發(fā)時(shí)延的方法(CA高接下來(lái)對(duì)應(yīng)讀操作，CA低 接下來(lái)對(duì)應(yīng)寫(xiě)操作)等，甚至未來(lái)有可能采用一些機(jī)器學(xué)習(xí)(Machine Learning)的方法對(duì) 讀/寫(xiě)信號(hào)進(jìn)行判別。讀時(shí)序和寫(xiě)時(shí)序波形分離出來(lái)以后，就可以方便地進(jìn)行波形參數(shù)或者 眼圖模板的測(cè)量。

克勞德高速數(shù)字信號(hào)測(cè)試實(shí)驗(yàn)室

DDR 規(guī)范的 DC 和 AC 特性

對(duì)于任何一種接口規(guī)范的設(shè)計(jì)，首先要搞清楚系統(tǒng)中傳輸?shù)氖鞘裁礃拥男盘?hào)，也就是驅(qū)動(dòng)器能發(fā)出什么樣的信號(hào)，接收器能接受和判別什么樣的信號(hào)，用術(shù)語(yǔ)講，就是信號(hào)的DC和AC特性要求。

在DDR規(guī)范文件JEDEC79R的第51頁(yè)[TABLE6:ELECTRICALCHARACTERISTICSANDDCOPERATINGCONDITIONS]中對(duì)DDR的DC有明確要求:VCC=+2.5V+0.2V，Vref=+1.25V±0.05V，VTT=Vref±0.04V.

在我們的實(shí)際設(shè)計(jì)中，除了要精確設(shè)計(jì)供電電源模塊之外，還需要對(duì)整個(gè)電源系統(tǒng)進(jìn)行PI仿真，而這是高速系統(tǒng)設(shè)計(jì)中另一個(gè)需要考慮的問(wèn)題，在這里我們先不討論它，暫時(shí)認(rèn)為系統(tǒng)能夠提供穩(wěn)定的供電電源。

除DC特性外，我們還應(yīng)該注意規(guī)范中提到的AC特性，所謂AC特性，就是信號(hào)在高速利轉(zhuǎn)狀態(tài)下所表現(xiàn)出的動(dòng)態(tài)變化特性。DDR規(guī)范中第60頁(yè)，對(duì)外于云態(tài)變化的地址信號(hào)、控制信號(hào)及數(shù)據(jù)信號(hào)分別給出了交流特性的要求。為方便讀者，現(xiàn)把規(guī)范中對(duì)干信號(hào)交流特性的要求復(fù)制到這里，作為高速系統(tǒng)設(shè)計(jì)的一部分，要確保在我們的系統(tǒng)中，所有處于高速工作狀態(tài)下的DDR信號(hào)要符合這個(gè)AC特性規(guī)范。 DDR DDR2 DDR3 DDR4 和 DDR5 內(nèi)存帶寬；

按照存儲(chǔ)信息方式的不同，隨機(jī)存儲(chǔ)器又分為靜態(tài)隨機(jī)存儲(chǔ)器SRAM(Static RAM)和 動(dòng)態(tài)隨機(jī)存儲(chǔ)器DRAM(Dynamic RAM)。SRAM運(yùn)行速度較快、時(shí)延小、控制簡(jiǎn)單，但是 SRAM每比特的數(shù)據(jù)存儲(chǔ)需要多個(gè)晶體管，不容易實(shí)現(xiàn)大的存儲(chǔ)容量，主要用于一些對(duì)時(shí) 延和速度有要求但又不需要太大容量的場(chǎng)合，如一些CPU芯片內(nèi)置的緩存等。DRAM的 時(shí)延比SRAM大，而且需要定期的刷新，控制電路相對(duì)復(fù)雜。但是由于DRAM每比特?cái)?shù)據(jù)存儲(chǔ)只需要一個(gè)晶體管，因此具有集成度高、功耗低、容量大、成本低等特點(diǎn)，目前已經(jīng)成為大 容量RAM的主流，典型的如現(xiàn)在的PC、服務(wù)器、嵌入式系統(tǒng)上用的大容量?jī)?nèi)存都是DRAM。DDR時(shí)鐘總線的一致性測(cè)試。浙江DDR一致性測(cè)試銷(xiāo)售電話

DDR4 電氣一致性測(cè)試應(yīng)用軟件。浙江DDR一致性測(cè)試銷(xiāo)售電話

DDR總線上需要測(cè)試的參數(shù)高達(dá)上百個(gè)，而且還需要根據(jù)信號(hào)斜率進(jìn)行復(fù)雜的查表修 正。為了提高DDR信號(hào)質(zhì)量測(cè)試的效率，比較好使用御用的測(cè)試軟件進(jìn)行測(cè)試。使用自動(dòng) 測(cè)試軟件的優(yōu)點(diǎn)是：自動(dòng)化的設(shè)置向?qū)П苊膺B接和設(shè)置錯(cuò)誤；優(yōu)化的算法可以減少測(cè)試時(shí) 間；可以測(cè)試JEDEC規(guī)定的速率，也可以測(cè)試用戶自定義的數(shù)據(jù)速率；自動(dòng)讀/寫(xiě)分離技 術(shù)簡(jiǎn)化了測(cè)試操作；能夠多次測(cè)量并給出一個(gè)統(tǒng)計(jì)的結(jié)果；能夠根據(jù)信號(hào)斜率自動(dòng)計(jì)算建 立/保持時(shí)間的修正值。浙江DDR一致性測(cè)試銷(xiāo)售電話

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